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Allegro PCB High-Speed Option Datenblatt

Allegro PCB High Speed Option
High-Speed Signale
Mit der High-Speed Option wird der Constraint Manager um viele elektrische Designregeln und deren online Pr├╝fung im PCB Editor erweitert. Abgebildet sind hier alle Regeln, die zum Designen von modernen High-Speed-Schnittstellen wie: DDR2, DDR3, DDR4, PCI Express und USB 3.0 erforderlich sind. Eine typische Regel ist zum Beispiel die dynamische Phasenkontrolle, bei der ein angegebener Phasenversatz bei differentiellen Paaren durch "bumps" in der k├╝rzeren Leitung des differentiellen Paares innerhalb eines definierten Bereiches ausgeglichen werden muss. Die Regelverletzung des dynamischen Phasenausgleichs wird als farblich gekennzeichneter Zahlenwert im Constraint Manager und als DRC-Verletzung im PCB Editor in Echtzeit angezeigt.

High-Speed Bunmp bei differentiellen Paaren
Phasenausgleich durch Bumps

Videos

Im Film wird gezeigt, dass unterschiedliche L├Ąngen eines differentiellen Paares zu einem Phasenversatz f├╝hren. Dieser wird mit Timing Vision anschaulich gemacht und anschlie├čend mit der Funktion Auto interactive Phase Tune (AIPT) gezielt ausgeglichen:


Wenn bei einem existierenden PCB Layout nachtr├Ąglich die Ecken einer Leitung optimiert werden sollen, so ist dies mit der Funktion AICC Autointeractive Convert Corner m├Âglich. W├Ąhlen Sie 90┬░, 45┬░ oder Arc mit beliebigen Radien und nach einem Klick werden alle Ecken angepasst.



High-Speed Netze und differentielle Paare haben diverse Designregeln, die alle eingehalten werden m├╝ssen. Um systematisch die Leitungen zu verlegen und gezielt auf die Regeln zu achten, dabei hilft die Timing Vision. Eine neue Art Regeln und Abh├Ąngigkeiten zu anderen Netzen sichtbar zu machen.



Zur Erweiterung des bestehenden Constraint Manager k├Ânnen Regeln auch ├╝ber Formeln definiert werden und dabei auf Daten des Designs (z.B. echte geroutete L├Ąnge) zur├╝ckgegriffen werden.

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